stm32: add stm32c0 support.
This commit is contained in:
@ -25,11 +25,11 @@ fn cpu_regs() -> pac::exti::Exti {
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EXTI
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}
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#[cfg(not(any(exti_g0, exti_l5, gpio_v1, exti_u5)))]
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#[cfg(not(any(exti_c0, exti_g0, exti_l5, gpio_v1, exti_u5)))]
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fn exticr_regs() -> pac::syscfg::Syscfg {
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pac::SYSCFG
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}
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#[cfg(any(exti_g0, exti_l5, exti_u5))]
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#[cfg(any(exti_c0, exti_g0, exti_l5, exti_u5))]
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fn exticr_regs() -> pac::exti::Exti {
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EXTI
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}
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@ -39,9 +39,9 @@ fn exticr_regs() -> pac::afio::Afio {
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}
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pub unsafe fn on_irq() {
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#[cfg(not(any(exti_g0, exti_l5, exti_u5)))]
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#[cfg(not(any(exti_c0, exti_g0, exti_l5, exti_u5)))]
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let bits = EXTI.pr(0).read().0;
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#[cfg(any(exti_g0, exti_l5, exti_u5))]
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#[cfg(any(exti_c0, exti_g0, exti_l5, exti_u5))]
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let bits = EXTI.rpr(0).read().0 | EXTI.fpr(0).read().0;
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// Mask all the channels that fired.
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@ -53,9 +53,9 @@ pub unsafe fn on_irq() {
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}
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// Clear pending
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#[cfg(not(any(exti_g0, exti_l5, exti_u5)))]
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#[cfg(not(any(exti_c0, exti_g0, exti_l5, exti_u5)))]
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EXTI.pr(0).write_value(Lines(bits));
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#[cfg(any(exti_g0, exti_l5, exti_u5))]
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#[cfg(any(exti_c0, exti_g0, exti_l5, exti_u5))]
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{
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EXTI.rpr(0).write_value(Lines(bits));
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EXTI.fpr(0).write_value(Lines(bits));
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@ -212,9 +212,9 @@ impl<'a> ExtiInputFuture<'a> {
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EXTI.ftsr(0).modify(|w| w.set_line(pin, falling));
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// clear pending bit
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#[cfg(not(any(exti_g0, exti_l5, exti_u5)))]
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#[cfg(not(any(exti_c0, exti_g0, exti_l5, exti_u5)))]
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EXTI.pr(0).write(|w| w.set_line(pin, true));
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#[cfg(any(exti_g0, exti_l5, exti_u5))]
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#[cfg(any(exti_c0, exti_g0, exti_l5, exti_u5))]
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{
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EXTI.rpr(0).write(|w| w.set_line(pin, true));
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EXTI.fpr(0).write(|w| w.set_line(pin, true));
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