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commit
81f7569a52
@ -303,20 +303,14 @@ impl<'a, C: Channel> Transfer<'a, C> {
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|||||||
ch.cr().write(|w| {
|
ch.cr().write(|w| {
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||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
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||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
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||||||
if incr_mem {
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w.set_minc(incr_mem);
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w.set_minc(vals::Inc::ENABLED);
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||||||
} else {
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w.set_minc(vals::Inc::DISABLED);
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}
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||||||
w.set_dir(dir.into());
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w.set_dir(dir.into());
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||||||
w.set_teie(true);
|
w.set_teie(true);
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||||||
w.set_tcie(options.complete_transfer_ir);
|
w.set_tcie(options.complete_transfer_ir);
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||||||
w.set_htie(options.half_transfer_ir);
|
w.set_htie(options.half_transfer_ir);
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||||||
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w.set_circ(options.circular);
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||||||
if options.circular {
|
if options.circular {
|
||||||
w.set_circ(vals::Circ::ENABLED);
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||||||
debug!("Setting circular mode");
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debug!("Setting circular mode");
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} else {
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w.set_circ(vals::Circ::DISABLED);
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||||||
}
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}
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||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
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||||||
w.set_en(true);
|
w.set_en(true);
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||||||
@ -352,7 +346,7 @@ impl<'a, C: Channel> Transfer<'a, C> {
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pub fn is_running(&mut self) -> bool {
|
pub fn is_running(&mut self) -> bool {
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||||||
let ch = self.channel.regs().ch(self.channel.num());
|
let ch = self.channel.regs().ch(self.channel.num());
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||||||
let en = ch.cr().read().en();
|
let en = ch.cr().read().en();
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||||||
let circular = ch.cr().read().circ() == vals::Circ::ENABLED;
|
let circular = ch.cr().read().circ();
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||||||
let tcif = STATE.complete_count[self.channel.index()].load(Ordering::Acquire) != 0;
|
let tcif = STATE.complete_count[self.channel.index()].load(Ordering::Acquire) != 0;
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||||||
en && (circular || !tcif)
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en && (circular || !tcif)
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||||||
}
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}
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||||||
@ -467,12 +461,12 @@ impl<'a, C: Channel, W: Word> ReadableRingBuffer<'a, C, W> {
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|||||||
let mut w = regs::Cr(0);
|
let mut w = regs::Cr(0);
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||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
|
||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
|
||||||
w.set_minc(vals::Inc::ENABLED);
|
w.set_minc(true);
|
||||||
w.set_dir(dir.into());
|
w.set_dir(dir.into());
|
||||||
w.set_teie(true);
|
w.set_teie(true);
|
||||||
w.set_htie(true);
|
w.set_htie(true);
|
||||||
w.set_tcie(true);
|
w.set_tcie(true);
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||||||
w.set_circ(vals::Circ::ENABLED);
|
w.set_circ(true);
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||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
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||||||
w.set_en(true);
|
w.set_en(true);
|
||||||
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||||||
@ -625,12 +619,12 @@ impl<'a, C: Channel, W: Word> WritableRingBuffer<'a, C, W> {
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|||||||
let mut w = regs::Cr(0);
|
let mut w = regs::Cr(0);
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||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
|
||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
|
||||||
w.set_minc(vals::Inc::ENABLED);
|
w.set_minc(true);
|
||||||
w.set_dir(dir.into());
|
w.set_dir(dir.into());
|
||||||
w.set_teie(true);
|
w.set_teie(true);
|
||||||
w.set_htie(true);
|
w.set_htie(true);
|
||||||
w.set_tcie(true);
|
w.set_tcie(true);
|
||||||
w.set_circ(vals::Circ::ENABLED);
|
w.set_circ(true);
|
||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
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||||||
w.set_en(true);
|
w.set_en(true);
|
||||||
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|
||||||
|
@ -382,18 +382,13 @@ impl<'a, C: Channel> Transfer<'a, C> {
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|||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
|
||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
|
||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
|
||||||
w.set_minc(match incr_mem {
|
w.set_minc(incr_mem);
|
||||||
true => vals::Inc::INCREMENTED,
|
w.set_pinc(false);
|
||||||
false => vals::Inc::FIXED,
|
|
||||||
});
|
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||||||
w.set_pinc(vals::Inc::FIXED);
|
|
||||||
w.set_teie(true);
|
w.set_teie(true);
|
||||||
w.set_tcie(options.complete_transfer_ir);
|
w.set_tcie(options.complete_transfer_ir);
|
||||||
|
w.set_circ(options.circular);
|
||||||
if options.circular {
|
if options.circular {
|
||||||
w.set_circ(vals::Circ::ENABLED);
|
|
||||||
debug!("Setting circular mode");
|
debug!("Setting circular mode");
|
||||||
} else {
|
|
||||||
w.set_circ(vals::Circ::DISABLED);
|
|
||||||
}
|
}
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||||||
#[cfg(dma_v1)]
|
#[cfg(dma_v1)]
|
||||||
w.set_trbuff(true);
|
w.set_trbuff(true);
|
||||||
@ -545,8 +540,8 @@ impl<'a, C: Channel, W: Word> DoubleBuffered<'a, C, W> {
|
|||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
|
||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
|
||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
|
||||||
w.set_minc(vals::Inc::INCREMENTED);
|
w.set_minc(true);
|
||||||
w.set_pinc(vals::Inc::FIXED);
|
w.set_pinc(false);
|
||||||
w.set_teie(true);
|
w.set_teie(true);
|
||||||
w.set_tcie(true);
|
w.set_tcie(true);
|
||||||
#[cfg(dma_v1)]
|
#[cfg(dma_v1)]
|
||||||
@ -703,12 +698,12 @@ impl<'a, C: Channel, W: Word> ReadableRingBuffer<'a, C, W> {
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|||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
|
||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
|
||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
|
||||||
w.set_minc(vals::Inc::INCREMENTED);
|
w.set_minc(true);
|
||||||
w.set_pinc(vals::Inc::FIXED);
|
w.set_pinc(false);
|
||||||
w.set_teie(true);
|
w.set_teie(true);
|
||||||
w.set_htie(options.half_transfer_ir);
|
w.set_htie(options.half_transfer_ir);
|
||||||
w.set_tcie(true);
|
w.set_tcie(true);
|
||||||
w.set_circ(vals::Circ::ENABLED);
|
w.set_circ(true);
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||||||
#[cfg(dma_v1)]
|
#[cfg(dma_v1)]
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||||||
w.set_trbuff(true);
|
w.set_trbuff(true);
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||||||
#[cfg(dma_v2)]
|
#[cfg(dma_v2)]
|
||||||
@ -878,12 +873,12 @@ impl<'a, C: Channel, W: Word> WritableRingBuffer<'a, C, W> {
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|||||||
w.set_msize(data_size.into());
|
w.set_msize(data_size.into());
|
||||||
w.set_psize(data_size.into());
|
w.set_psize(data_size.into());
|
||||||
w.set_pl(vals::Pl::VERYHIGH);
|
w.set_pl(vals::Pl::VERYHIGH);
|
||||||
w.set_minc(vals::Inc::INCREMENTED);
|
w.set_minc(true);
|
||||||
w.set_pinc(vals::Inc::FIXED);
|
w.set_pinc(false);
|
||||||
w.set_teie(true);
|
w.set_teie(true);
|
||||||
w.set_htie(options.half_transfer_ir);
|
w.set_htie(options.half_transfer_ir);
|
||||||
w.set_tcie(true);
|
w.set_tcie(true);
|
||||||
w.set_circ(vals::Circ::ENABLED);
|
w.set_circ(true);
|
||||||
#[cfg(dma_v1)]
|
#[cfg(dma_v1)]
|
||||||
w.set_trbuff(true);
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w.set_trbuff(true);
|
||||||
#[cfg(dma_v2)]
|
#[cfg(dma_v2)]
|
||||||
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